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cclk_vhdl
  • 분류:하드웨어/embedded - VHDL
  • 도구 개발:Others
  • 크기:638 KB
  • 업로드 시간:2009/5/29 3:14:25
  • 업 로더:admin_ittc2
  • 다운로드 통계:
설명
는 Quartus II 프로젝트 파일, 전형적인 디지털 시계의 FPGA - 기반 프로젝트에는 하위 - 최고 50MHz 주파수, 세고, 모듈 디코딩됩니다. VHDL 언어를 사용합니다.




File list:
clk_vhdl.qar
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