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digtak다운로드하드웨어/embeddedVHDL
검색:
bijiaoqi
  • 분류:하드웨어/embedded - VHDL
  • 도구 개발:VHDL
  • 크기:120 KB
  • 업로드 시간:2010/5/26 2:21:43
  • 업 로더:Wo_it
  • 다운로드 통계:
설명
4 비교기, 프로그램 디버깅을 아무 문제없이 실행 Verilog를 사용하여 작성.




File list:
四位比较器
....\db
....\..\cmp.(0).cnf.cdb
....\..\cmp.(0).cnf.hdb
....\..\cmp.asm.qmsg
....\..\cmp.cbx.xml
....\..\cmp.cmp.cdb
....\..\cmp.cmp.hdb
....\..\cmp.cmp.logdb
....\..\cmp.cmp.rdb
....\..\cmp.cmp.tdb
....\..\cmp.cmp0.ddb
....\..\cmp.dbp
....\..\cmp.db_info
....\..\cmp.eco.cdb
....\..\cmp.fit.qmsg
....\..\cmp.hier_info
....\..\cmp.hif
....\..\cmp.map.cdb
....\..\cmp.map.hdb
....\..\cmp.map.logdb
....\..\cmp.map.qmsg
....\..\cmp.pre_map.cdb
....\..\cmp.pre_map.hdb
....\..\cmp.psp
....\..\cmp.pss
....\..\cmp.rtlv.hdb
....\..\cmp.rtlv_sg.cdb
....\..\cmp.rtlv_sg_swap.cdb
....\..\cmp.sgdiff.cdb
....\..\cmp.sgdiff.hdb
....\..\cmp.signalprobe.cdb
....\..\cmp.sld_design_entry.sci
....\..\cmp.sld_design_entry_dsc.sci
....\..\cmp.syn_hier_info
....\..\cmp.tan.qmsg
....\..\cmp.tis_db_list.ddb
....\..\cmp_cmp.qrpt
....\.xhdl3.xref
....\cmp.asm.rpt
....\cmp.cdf
....\cmp.done
....\cmp.fit.eqn
....\cmp.fit.rpt
....\cmp.fit.smsg
....\cmp.fit.summary
....\cmp.flow.rpt
....\cmp.map.eqn
....\cmp.map.rpt
....\cmp.map.summary
....\cmp.pin
....\cmp.pof
....\cmp.qpf
....\cmp.qsf
....\cmp.qws
....\cmp.sof
....\cmp.tan.rpt
....\cmp.tan.summary
....\cmp.v
....\cmp_assignment_defaults.qdf
....\cmp_state.ini
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