하드웨어/embedded - VHDL24 - 소스 코드를 다운로드

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576.VerriRiscCPPU

Verilog HDL을 사용하여이 문서의 사용이 쉽지 - - CPU의 프로세스는 마이크로 - 설계 및 개발을 달성하는 기본적인 컴퓨팅을 이해하는

time: 2008-08-04 size:18.0 KB KB tool:VHDL down: 3

577.VHDDLzip

맨체스터 -乇고체 무거운 분위기腣HDL을 소스 코드의 소스 코드를 소스 코드의 무결성 역풍, 그리고?  중구 VHDL 코딩 소스 코드에 직접 사용될 수있습니다.

time: 2008-08-04 size:11.0 KB KB tool:VHDL down: 1

578.Mussic_alteera

에 Verilog HDL을 설계의 사용, 알테라의 개발의 실현에 EP1S10S780C6 - 보드 6MHz의 주파수에 따라 선택, 콘서트 음악 접영입니다

time: 2008-08-03 size:638 KB KB tool:Windows_Unix down: 1

579.usbb11_systtemc

관련 문서를 의사와 함께 언어를 포함은 USB 1.1 PHY 인 코드, SystemC를 1월 1일의 USB PHY가 언어 코드, SystemC를 언어, SystemC를 기반 testbench,

time: 2008-08-03 size:190 KB KB tool:C-C++ down: 2

580.reff-ddr-sdram-vhhdl

VHDL 소스 코드와 개발의 DDR SDRAM 컨트롤러

time: 2008-07-21 size:1008 KB KB tool:Windows_Unix down: 1

581.Elevator Control Circuit Road Control

엘리베이터 제어 회로, Verilog 쓰기 사용

time: 2008-07-21 size:3.00 KB KB tool:WINDOWS down: 1

582.MMYYCPU2.0

FLEX10K 간단한 CPU를 사용하여 개발을 달성 Verilog

time: 2008-07-21 size:26.0 KB KB tool:多平台 down: 1

583.LEDD point again and

대형 스크린을 주도, 도트 - 매트릭스 디스플레이는 타이밍이 드라이버에 의해 구동. 언어의 사용으로 VHDL 설명. Rom에 사용할 수있는 파일은 lpm

time: 2008-07-21 size:5.00 KB KB tool:其他 down: 1

584.Custom logic PWM of cases defined example of

언어 VHDL 소스의 PWM 절차에 의해 개발, 쉽게는 Nios와 연결하는 데 사용될 수있다는 Nios 기능의 확장을 얻을 수있습니다. 완전한 소스 코드를 직접적으로 사용될 수있습니다.

time: 2008-07-21 size:11.0 KB KB tool:Windows_Unix down: 0

585.Xilinx provides _vvhdl 曼彻斯斯特 codec

맨체스터 코덱 소스에 코드를 제공하는 자일링스의 VHDL

time: 2008-07-21 size:11.0 KB KB tool:多平台 down: 3

586.The source code on behalf of a number of VVHDL

, 완전한 소스 코드와 같은 해당 테스트 벡터 adder, 16 × 8bit의 RAM, FIFO, 일반 RAM을 소스에 직접 사용될 수있다에는 파형 발생기, adder, 클래식 듀얼 - 프로세스 상태 머신, 사이비 - 무작위 생성기 요리입니다.

time: 2008-07-21 size:45.0 KB KB tool:Windows_Unix down: 0

587.80551IPcore, veriloggHDL achieve

Verilog 아주 좋은 CPU 코어로 작성된

time: 2008-07-21 size:52.0 KB KB tool:多平台 down: 1

588.ffppgasong

초급에서 초보자를위한 노래의 개발에 Verilog HDL을 언어

time: 2008-07-21 size:2.00 KB KB tool:Asm down: 1

589.pinng_panng

이것은 AHDL 언어를 수집 시스템의 PCI 로직 소스, 어떤에서 핑의 혁신적인 디자인 - 탁구, 누가 친구에게 관심을 참조할 수있다! maxplus2 완전한 소스 코드를 직접 사용할 수있는 컴파일러 환경을 제공합니다.

time: 2008-07-21 size:428 KB KB tool:多平台 down: 1

590.I2SSrar

이 소스 코드는 VHDL 소스 코드를 달성하는 I2S 인터페이스입니다, I2S 일반 오디오 인터페이스입니다.

time: 2008-07-21 size:1.51 MB KB tool:其他 down: 0

591.Pussh_Boxxes

VHDL 소스 코드, 소스 코드 sokoban 게임은 과제를 달성하기 위해 자일링스 개발 환경 절차, 아주 아름다운 인터페이스 있음. 완전한 소스 코드를 직접적으로 사용될 수있습니다. 이 테스트를 통과했다.

time: 2008-07-21 size:7.00 KB KB tool:多平台 down: 1

592.runn_length_codinng

Verilog 영상 압축의 발전을 실행 길이 인코딩 인코딩을 사용하여 (RLE) 교환 계수 (Aa) 인코딩을 실행하는 데 사용 lengthencoding.

time: 2008-07-21 size:9.00 KB KB tool:多平台 down: 2

593.mattlab-ffft

MATLAB the FFT 방법의 실현 자체했다, 우리가 참조할 수있습니다.

time: 2008-07-21 size:2.00 KB KB tool:Windows_Unix down: 1

594.JPEEG2000_FPGA_Deesign

이 신문의 JPEG2000에 임베디드 FPGA 설계에 초점을 맞추고 블록 코딩, 매우 유용한

time: 2008-07-21 size:758 KB KB tool:多平台 down: 2

595.coddeofvhdll2006

다운로드에 대한 기본 설계】【VHDL 소스 코드 ~ ~ 하나는 고전적인 디자인의 위치 : 기계 【】, 【시계】, 【교통 신호등 교통 신호 시스템】, 【스테퍼 모터의 위치 제어 시스템】, 【DC 모터 속도 제어 시스템】 자동 판매기 , 계산기 【】, 【포인트 배열 디스플레이 제어 시스템은 디지털 로직의】 기본 설계 : LED가 【】, 【】 MUX는, 3 - 상태 게이트 【】, 【양방향 입력 | 출력 포트】, 래치 【내부 (버퍼) 신호】, 【】 전환 인코딩, adder 【】, 【인코더 / 디코더】, 【】 4 배율, ROM과 【】, 【RSFF 트리거

time: 2008-07-21 size:44.0 KB KB tool:多平台 down: 3

596.verrilog_ise_spatann3_clock

시계의 예로는 - 소스 Verilog 프로그램은 칩의 완전한 소스 코드를 컴파일 spatan3 이세에 직접 사용될 수있습니다.

time: 2008-07-21 size:449 KB KB tool:其他 down: 1

597.de22_clocck

DE2 보드, 보드에 시계 기능을 달성하기 위해 LCD는 액정 표시 장치를 확인할 수있습니다.

time: 2008-07-21 size:80.0 KB KB tool:多平台 down: 1

598.FFPPGApro

Verilog HDL을 소스 실제 산업 프로젝트의 소스 코드를 직접 작성 quartus2 알테라의 개발 도구를 사용할 수있습니다. 이 테스트를 통과했다.

time: 2008-07-21 size:1.17 MB KB tool:C-C++ down: 1

599.llooadGIF

SDK는 파일은 재무에 대한 대응이 필요 vgsdk 프로젝트를 실행하는 데 사용은 GIF 읽기